摘要：介绍了基于cPCI总线的新一代嵌入式遥测前端处理器的体系结构设计和通用OEM硬件选择，重点介绍了多功能双路PcM分路器板的设计与实现，简述了遥测前端处理器中的软件。
关键词：嵌入式遥测前端处理器cPCI总线分路器
遥测数据处理系统在航空、航天等军工试验领域有着广泛的应用。在航空飞行试验中．遥测数据处理系统为各类试飞测试数据的实时处理提供了手段和平台，试飞员、试飞指挥员及试飞工程师协同完成新机试飞必不可少的重要设施，是确保现代飞机试飞安全、提高试飞效率、缩短试飞周期、实现综合试飞的重要手段。
遥测数据处理系统中的核心设备——遥测前端处理器，技术上经历了从分立式、智能式到嵌入式的快速发展。我遥测前端处理器的研发经历了从引进、合作研制到完全自行研制的历程。
遥测前端处理器是一套嵌入式实时计算机系统，承担着遥测PCM数据的同步、分路、工程单位转换、数据计算、数据分配等实时处理任务。它和遥测系统管理服务器、工作站等设备通过网络联接和系统集成，组成当前流行的基于C／S结构的遥测数据处理系统。可以说，遥测前端处理器的技术水平代表了遥测数据处理系统的技术水平。
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遥测前端处理器的功能简单地说，就是把来自遥测接收设备送来的多路串行PCM(Pulse Code Modulation)数据流进行同步、分路、合并、存储，并对转换后的并行数据进行工程单位转换、导出数计算等实时处理，通过网络把数据传送给显示工作站。再通过遥测记录数据重放，为用户提供同实时方式一样的处理功能和更为详细的数据分析功能。
遥测前端处理器主要技术指标为：
(1)可同时完成2路PCM数据流的同步和分路，每路PCM速率不大于20Mbps。
(2)实时数据处理速率：20Mbps。
(3)数据传输：交换式以太网、网络带宽1000Mbps、广播方式和“点对点”方式。
(4)数据存储：满足在最大速率下数据存储不丢失，磁盘容量满足不小于4小时的记录时间。
(5)D／A输出：12位、16路模拟信号输出。
2 系统组成和体系结构设计
二十世纪90年代，因受当时的计算机技术限制，国内外大多数嵌入式遥测前端处理器都采用了基于VME总线的计算机平台和双总线、多CPU、百兆以太网接口的体系结构，其技术复杂、成本高、软件开发难度大、系统研制周期。
当前计算机技术的发展，使得CPU速度和总线速率已不再是新一代嵌入式遥测前端处理器的瓶颈，基于单CPU、单总线和千兆以太网接口的体系结构成为新一代嵌入式遥测前端处理器的主流设计。板卡化后的遥测前端设备，如码同步器、分路器、时码发生器等作为计算机的一个插件板，嵌到工业计算机系统中，其组成已简化为：19英寸计算机箱、CPU板、多功能PCM分路器板、时码板、D／A板和存储设备，其典型结构与组成见图1所示。新一代嵌入式遥测前端处理器体系结构简化，性能和可靠性提高，成本降低，研制周期缩短，更容易集成为基于C/S结构的多数据流遥测数据处理系统。
3 硬件设计
3．1 总线平台和OEM板卡的选择
计算机总线平台是嵌入式遥测前端处理器的关键，当前国外嵌入式遥测前端处理器均选用了目前流行的Compact PCI计算机总线平台。该平台吸收了PC机商用技术的最新成果，数据传输速率满足新一代嵌入式遥测前端处理器实时处理多条PCM数据流时的传输要求，环境条件、可靠性等都满足运输类飞机机载、地面活动车载等环境使用要求。
遥测前端处理器中的其他硬件，除PCM分路器板外，均选用了OEM产品。机箱选用12槽Compact PCI机箱(包括电源组件和磁盘)；根据处理要求，本设计的CPU板选用了美国SBS公司的C7系列，CPU PⅢ1GHz，RAM 1GB，2个1000Mb以太网口，1个SCSI口。时码板选用了美国DATUM公司带GPS授时的BC637；D／A板选用了美国NI公司的N16713系列，每板8通道．每通道lMSps，D/A分辨率为12位。
考虑到单片式全数字码同步器在国外已有使用，因此在多功能双PCM分路器板设计时已预留了单片码同步器的芯片位置。本设计码同步器选用外置式码同步器。
3．2 多功能双PCM分路器板的设计与实现
PCM分路器板是嵌入式遥测前端处理器的关键插件，国外也有不少单板、单PCM分路的OEM产品。但高端产品的购置受到西方国家诸多限制，因此，选取了自行设计的技术途经，研制成功了基于Compact PCI总线的多功能双路。PCM分路器板，其技术水平达到当前国际先进水平。
3．2．1 PCM分路器板的硬件逻辑设计
多功能双PCM分路器的原理框图如图2所示，由双PCM分路器(包括帧同步检测、帧/子帧同步策略及相应的时序控制逻辑等)、PCM模拟器、语
CPLD选用了Latfice公司的ISP 4512V系统在线可编程器件。由于ISP便于现场更改，降低了研发成本，缩短了系统调试时间。
在众多通用的PCI接口芯片中，选用了目前业界设计选用的主流芯片：PLX公司的PLX9054。PLX9054是一种功能强、使用灵活并符合PCIV2．2规范的32位、33MHz的。PCI总线接口控制器，它可以作为PCI总线的主控设备去控制总线，也可以作为目标设备去响应总线。PIX9054提供了PCI总线、EWROM、IDCAL总线3个接口，作为一种“桥”芯片，在PCI总线和LOCAL总线之间有3种直接的数据传输模式。本设计选用了DMA数据传输模式。PLX9054以其强大的功能和简单的用户接口，为PCI总线接口的开发提供了一种简洁的方法，设计者只需设计本地总线接口控制电路，即可实现与PCI总线的高速数据传输。
3．2．2 帧、子帧同步及同步策略的实现
PCM数据一个参数是以一个字或多个字的方式表达的，每个字由若干码元组成，而在一个PCM采集系统中，所有测试参
按照数据采集方案的格式要求，预先由处理器进行初始化设置，包括帧同步码组、同步码组的长度和允许同步码组的错误位数。随着时间的推移，PCM数据在CLDCK信号的控制下，逐位进入移位寄存器，移位寄存器的输出数据进入比较器，随时与帧同步码组进行比较，在同步码组长度逻辑的控制下，一旦检测到可能的同步码组，则比较器输出同步信号，该同步信号还必须由判决器来进行判决才能决定其是否有效。其方法是：预先设置允许的错误容限也就是允许的错误位数，然后根据比较器的输出信号是否满足错误容限的要求来决定真正的同步信号的输出。帧同步信号的产生为整个PCM分路器板提供了最基本、最重要的时序依据。
帧同步策略是PCM分路的关键技术之一，其意义在于最大限度地解决数据传输过程中造成的“漏同步”和“假同步”现象，以降低误码率，进一步提高数据检测的可靠性和有效性。一种基本的且经实践检验行之有效的帧同步策略是：在帧同步检测完成后，按照PCM格式定义的PCM字长和帧长，连续找到几个(一般为3个)相匹配的同步码组后，即认为帧确为同步。
帧同步策略的逻辑实现如图4所示。由图4可以看出，帧同步的正确性可以依据以下条件：
(1)同步码组的正确性。
(2)帧长的正确性(通过帧长计数器与帧长预置值的比较实现)。
(3)同步、检测和失步的判别。不同的设计者可采用不同的方法，目的是消除假同步和漏同步的影响。可以采取以下方法：若比较器连续出现3个相等值时同步，当有一个不等值时，进入检测状态；而当出现连续3个不等值或检测一定时间后不能同步时，则进入失步状态。
以上解决了帧同步的问题，也就是找到了每一帧的起止位置。然而，每一帧的各数据字在特定的测试方案中又不可能相同，如何来确定某个参数字在哪一帧的哪个位置?帧同步以后，数据传输的正确位置是否可靠?就是子帧同步要解决的问题。多年来，国内外广泛采用的于帧同步方式为ID同步方式。
子帧同步策略是PCM分路的另一关键技术，其意义在于：在帧同步的基础上，对数据的可靠性作进一步的容错检测。一种常用的且经实践检验较为可靠的子帧同步策略是：连续检查几个子帧数据(一般为3个)，其子帧同一位置的ID字如果相同或相邻子帧相应的ID字连续，则判决为子帧同步，否则子帧不同步。
子帧同步策略逻辑实现如图5所示。由图5可以看出，子帧同步与策略的正确性依据以下条件：
(1)ID字位置及其值的正确性(如过零检测)。
(2)子帧长的正确性(通过子帧长与帧计数器值的比较判断)。
(3)同步、检测和失步的判别，方法与帧同步策略类似。
在本设计中，双PCM帧同步检测、帧/子帧同步策略均通过CPLD逻辑器件实现，不仅提高了设计的集成度，而且提高了系统的可靠性及其性能，使每路PCM分路速率达到20Mbps的国际先进水平。
4 软件平台选择及软件组成
目前常用的遥测前端处理器操作系统有Windows2000和VxWorks二种。Windows200
遥测前端处理器软件组成与实时数据处理流程框图如图6所示。
图6 遥测前端处理器软件组成与实际工资时数据处理流程
遥测前端处理器中的软件由PCM数据采集、参数提取、工程单位转换、数据合并与导参数计算、报警参数处理、数据存储、网络通信与数据分配等模块组成。其中，采集、参数提取、工程单位转换模块与数据流相对应，每个数据流单独一套。PCM数据经采集后，接事先定义对参数进行提取、工程单位转换和必要的处理、存储。按事先设置，需要模拟输出的数据直接由D/A板输出，通过网络把工程单位数据和原始数据传输给工作站，由工作站完成遥测数据的各种方式的可视化显示和飞行试验专用数据分析与处理。
基于cPCI总线的新一代嵌入式遥测前端处理器的设计和实现，使遥测数据处理系统的集成更加容易。其20Mbps的速率、双路PCM数据的分路和实时处理能力。可满足现代军、民机飞行试
